特性 | 描述 | ||||
指令集架构 | RV32 IMA(FD)C(B)(P)_Zicsr_Zifencei_Zicbom_Zicond_(Zfh) | ||||
流水线 | 6级超标量顺序双发射流水线,带分支预测器(Branch Predictor) | ||||
模式 | 机器模式(Machine-mode)、监督模式(Supervisor-mode)、用户模式(User-mode) | ||||
安全 | PMP保护区域最高可达16个,SPMP保护区域最高可达16个; 支持 PPMA(Programmable Physical Memory Attributes) 检查 |
||||
指令紧密集成存储(ITIM) | 0-128MB大小可配,Parity/ECC 可选 | ||||
数据紧密集成存储(DTIM) | 0-128MB大小可配,Parity/ECC 可选 | ||||
L1 指令缓存(L1 I$) | 4KB-128KB大小可配置, Parity/ECC 可选 | ||||
L1 数据缓存(L1 D$) | 4KB-128KB大小可配置, Parity/ECC 可选 | ||||
中断 | 支持CLIC中断控制器,至多支持1008个快速中断; 支持NMI不可屏蔽中断 |
||||
浮点运算单元 (FPU) | 支持双精度、单精度,以及RISC-V Zfh半精度浮点拓展 | ||||
数字信号处理单元 (DSP) | 支持单指令多数据(SIMD)指令,支持全量的RISC-V RV32P拓展 | ||||
调试跟踪 | 调试模块(Debug module)支持JTAG/cJTAG,支持SBA(System Bus Access); 跟踪模块(Trace module)支持RISC-V N-Trace |
||||
总线接口 | 1.内存接口(Memory Port):64位AXI主接口; 2.外设接口(Peripheral Port):32位AHB主接口; 3.前置接口(Front Port):64位AXI从接口,用于从外部访问 ITIM 和 DTIM; 4.I/O一致性接口(CCP Port):64位AXI从接口,用于实现I/O一致性 |
||||
CoreMark(CoreMarks/MHz) | 5.26 | ||||
Dhrystone-Legla(DMIPS/MHz) | 2.89 |